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2 resultados encontrados.

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Post-silicon Validation Procedure for a PWL ASIC Microprocessor Architecture
Artículo
Acceso abierto Artículo CONICET Digital
Post-silicon Validation Procedure for a PWL ASIC Microprocessor Architecture
Lifschitz, Omar D. et al · Institute of Electrical and Electronics Engineers · 2011 · ISSN 1548-0992
In this paper, we present the environment set for validation and testing a particular ASIC that implements a piecewise linear (PWL) architecture. Description for a package debug propose is included. Methodologies for pow...
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Acceso abiertoRuta libre sin proxy. Acceso recomendado cuando no hay suscripción activa.
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A Rigorous Mathematical Formulation for the Scheduling of Tree-Structure Pipeline Networks
Artículo
Acceso abierto Artículo CONICET Digital
A Rigorous Mathematical Formulation for the Scheduling of Tree-Structure Pipeline Networks
Cafaro, Diego Carlos et al · American Chemical Society · 2011 · ISSN 5064-5085
Pipeline networks are the dominant mode of conveying a wide variety of oil refined products from refineries to distribution terminals. Pipeline infrastructure usually comprises trunk lines serving high-volume, long-haul ...
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